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Xilinx FPGA应用进阶——通用IP核详解和设计开发

文字:[大][中][小] 2014-9-19    浏览次数:2669    

Xilinx FPGA应用进阶——通用IP核详解和设计开发 ,本书系统讲解通信网络领域Xilinx FPGA内部的IP硬核。以流行的Xilinx Virtex-6型号芯片举例,涵盖Xilinx FPGA在通信领域主流的IP核,阐述Xilinx FPGA时钟资源和DCM、PLL和MMCM时钟管理器的特性和使用方法;介绍基于Block RAM资源生成ROM、RAM、FIFO和CAM核的使用过程。阐述TEMAC核背景知识、内部结构、接口时序和配置参数,给出生成实例;介绍LVDS技术规范、源同步实现方案和去偏移技术,讲解Xilinx FPGA中IODELAYE1、ISERDES1和OSERDES核使用方法;阐述Xilinx FPGA DDR3控制器IP核的结构组成、模块划分、接口信号和物理约束等。

黄万伟、董永吉负责全书的统筹规划。第1章由黄万伟、陶勇和李玉峰完成;第2章由冶晓隆、黄万伟和李玉峰完成;第3章由黄万伟、钱坤和伊鹏完成;第4章由黄万伟、姜宏和伊鹏完成;第5章由黄万伟、田乐和姜宏完成;第6章由董永吉、钱坤和田乐完成。曹建业完成了本书的实验仿真部分,陶勇绘制了本书中的大量插图,姜宏、陈博和杨文慧参与了本书的文字校订工作。在本书编写过程中,杜飞、谭立波、袁征、张霞、田志给予了大力支持,并提出了宝贵意见。特别感谢科通数字技术公司西安办事处的杨智勇工程师和上海皮赛电子有限公司朱哲勇先生在本书编写过程中给予的大力技术支持。感谢国家“973”项目“可重构信息通信基础网络的理论和体系结构”课题的NetFPGA实验仿真小组张传浩博士、胡宇翔博士和张震博士提供的技术支持。

Xilinx FPGA应用进阶——通用IP核详解和设计开发

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